La arquitectura de conexión directa puede aumentar el rendimiento y la eficiencia general de tu sistema mediante la eliminación de los cuellos de botella tradicionales relacionados con las arquitecturas de bus frontal heredadas.
Los buses frontales heredados limitan e interrumpen el flujo de datos. Un flujo de datos más lento implica mayor latencia, que se traduce en un rendimiento del sistema más lento. La interrupción del flujo de datos implica una escalabilidad limitada del sistema.
La arquitectura de conexión directa permite eliminar los buses frontales. En su lugar, el núcleo del procesador se conecta directamente a la memoria, al subsistema de E/S y a cualquier otro procesador de la configuración mediante las conexiones Hypertransport™ de gran ancho de banda. El controlador de la memoria se localiza en la placa del procesador, en lugar de la placa base, como en el caso de las arquitecturas de bus frontal. Esto reduce en mayor medida la latencia y aumenta el rendimiento.
La Arquitectura de Conexión Directa sólo está disponible con procesadores AMD64, incluidos los procesadores AMD Opteron™ y AMD Athlon™ 64, así como con la tecnología AMD Turion™ 64 Mobile.
Entre las características exclusivas de la Arquitectura de Conexión Directa se incluyen:
Controlador de memoria integrado
Los procesadores AMD64, con arquitectura de conexión directa, poseen un controlador de memoria integrado en placa, lo que optimiza el rendimiento de la memoria y el ancho de banda por CPU y disminuye la latencia relacionada con las arquitecturas de bus frontal. El ancho de banda de memoria de AMD aumenta a medida que los procesadores se añaden a la configuración, a diferencia del caso de los diseños heredados en los que el incremento es escaso debido a que el acceso a la memoria principal está limitado por los chips Northbridge externos.
Tecnología HyperTransport™
La tecnología HyperTransport™ es un enlace de comunicación entre puntos, de alta velocidad, bidireccional y de baja latencia, que permite una interconexión de ancho de banda escalable entre núcleos, subsistemas de E/S, bancos de memoria y otros chipsets.
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